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HART变送器的低功耗设计

发布时间:2019-07-13 17:22:22来源:

  到80多家著名仪器仪公司的支持,并于1993年成立了1灯信基金会。虽然,1协议被认为是现场总线的雏形,是种过渡性协议,但由于目前使用420标准的现场仪大量存在,所以,现场总线进入工业应用之后,1抓仍会应用好多年,山于凡尺办议狼容42,1标准,所以,在设汁符介久1;1办议的智能变送器时,必须实现低功耗设计,将变送器电流控制在3.5,以下。文中就设计中关于降低功耗方面1设计中的若干技术问所设计的1取变送器1.

  调制解调器20012提供迎旧能力,微1.1选用入0421转换器1它由环路供屯,16位数字信号以串行方式输入,经过转换后输出420人电流。

  可实现低成本智能工业控制。入0421内部含有电压调整器,外接场效应管可提供+5,3.3或3输出屯压木设计采用5.

  还含有+1.25,+2.5基准源,均可为自身或其它电路采用。人,421采用2,人0结构,16位的分辨率和单调性,其积分误差±益误差为±0.2.入,421与标准的入抓电路或其它类似的3协议电路完全兼容,标准的线串行接口可以在98下运行,便于与通用微处理器或微控制器相连,人0421比较大静态电流为750队实际应用中,01公手册中给出的电源调悠管250在内内七法采购到,如采月1国产管38代换,似3用的耐压值较低20,并且代换效果不是很好,建议在设计中放弃使用人0421内部的电压调整器,而直接使用人01公司准,自身功耗极低,允许浮地接法1.

  12采用Pa6C770微控制器理器,所方1处可器都采用种宄进的指令集,汇16,70己增强了芯片的功能,级硬件堆栈,多个内部与外部中断源。指令总线与数据总线分汗的哈佛结构,4界纳14位指令。8位数据,两级指令线,使得所有指令除程序跳转指令外,均为单周期指令。共有33条指令6,70有2程序存储器,256字节凡,及6通道12位人0转换器,非常适合应用于低成本,05器件的静态功耗极低,若注总控制电路的电平和负载电阻的接法,其静态功耗可减少到从级。而,影3电路的动态功耗与驱动信号的波形有关。,肘03数字集成电路的基本单元是个反相器它由个增强型沟迅管和个增强型沟道0抑03管串接成互补结构组成。

  该电路的0态或1态时只有个管子导通,另个管子截止。当电路状态翻转时,必有瞬间两个管子同时导通,此时功耗比较大。如果驱动信号量的平均值等于电流值对时间的积分与重复频率少而降低因此。将160770系统时钟频率降低不影响系统性能的情况下,可以减少功耗。

  如在5,4出条件下,电流为2,而在5,321出,条件下。电流为120,此外。还应注意单片机的10口,在不需要10口输出时,应将口设置成输出的高状态或低状态,=因为,0取8内部若上拉会加大250400以的电流,建议关闭,改用外部大电阻实现上拉。另外,80只模块应关闭;贾01关闭开启会加多左右的电流。这柞就能减少部分功妒。

  柬202标准它为札变送器提供调制解调功能。120,2本身己经考虑了低功耗要求,例如,进行调制时关闭解调部分以节能,反之亦然,为80队外界提供个460.8142的时钟。这个时钟可由个独立的振荡器来产生。实现方法是从输入到输出连接大阻值的电阻,把,0肘3反相器偏置成线性放大器,其中反相器米用六反相器4069.这时应注意未用的反相器的输入脚的接法。由于器件圮电压抟制器件。它的输入阻抗很高,如果输入引脚浮空,在其上容易枳累电荷产生较大的感生电动势。从而使反相器输出级两个,莹管同十处于导1山状态,大大±朽加了1路功耗。因而4069未用的反相器输入端均应通过上拉屯肌接在。,上,经实测460.82振,器作屯流为250广然而,反相器电路存在问,电源电流在3 6电源范围内宽幅波动,而且很难达到低于250的电流。电源电压的大幅变化可能使工作+可靠3!动困难,要求苛刻使叫晶体振荡器可解决这些问,2.

  仅从5电源吸收30的电流,包括单晶体管放大器振荡器以及低功率比较器基准器件忙1的坫极经过出。4以及的基准偏置到1.25,约为。7,发射极迓于近似0.5.1两端的不变电味把晶体管的静态电流设迓在5,这把集电极电压,定在低于1.

  晶体与负载电容山和心起组成了围绕,1的反馈通道,其180相移导致振荡。,4将振荡信号耦兮到比较器输入。

  此电路宽范围电压条件下2.51启动快速可靠,可以用任何在5时具有100左右放大系数的小信号晶体管。

  1.4采用0液晶显器在低功耗设计中,液晶显器由于低功耗特性而成为显模块的首选。本设计采用了0310位8段带小数点的液品显模块。

  2结语经实测免送器屯流完全满足要求。

  Applications,199632318322黄俊。电力电子学变流技术幻。北京机械工业出版社,1996

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